聚焦 FPGA 设计、嵌入式开发与可编程技术

在I/O和时钟规划之后，需要验证设计以确保其满足设计需求。Vivado提供了两种验证途径：DRCs用来检查设计违反规则情况；SSN分析用来估计转换噪声等级。本文将介绍DRCs，本系列第16篇介绍了SSN分析。

运行DRCs
DRCs可以说是管脚规划中最严苛的一个步骤，DRCs会使用一套设计检查项（通常称作rule deck），来检查当前设计是否违反这套规则。本文将以运行DRCs检查I/O端口和时钟逻辑为例。

很多人对FPGA理解还停留在CPLD阶段，认为FPGA只是用来做一些逻辑接口或算法而已，那就大错特错了，如果你一直做FPGA的逻辑而又不是很精通，又或者做其它嵌入式（如单片机、ARM）开发可以看下这篇文章，或许对你有所帮助。
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【视频】从边缘到云端的网络安全

赛灵思、英飞凌科技、安富利和 Mocana 合作推出符合 IEC 62443 标准的硬件和软件现成解决方案。
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学会System Generator（16）——流水线设计方法详解

本文是该系列的第16篇。流水线（pipeline）是FPGA设计中经常提到的一种技巧，通过消耗更多的资源来提升系统的运行速度。本文将以FIR滤波器的设计为主题，详细介绍如何把一个设计“流水线化”，并进行时序分析体会流水线设计带来的好处。

流水线
这里先用通俗易懂的语言描述一下流水线设计思想。假设小A要从成都到哈尔滨旅游，如果直接坐火车过去恐怕要累得受不了；如果在旅程中间加几站，比如到西安、北京、天津找个客栈休息一下，路上就更加精力充沛了。

【视频】Sony 的 SLVS-EC 标准

了解使用面向第三代 Pregius 成像器的索尼全新 SLVS-EC 接口标准。
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Zynq-7000 PL端HDMI的显示控制

作者：OpenSLee

1 背景知识

HDMI（High Definition Multimedia Interface）是高清晰多媒体接口线的缩写，能高品质地传输未经压缩的高清视频和多声道音频数据，最高数据传输速度为5Gbps。同时无需在信号传送前进行数/模或者模/数转换，可以保证最高质量的影音信号传送。

您的设计中有低语者吗？

作者：德州仪器 Atul Patel

大家许多人可能都与“低语者”有过交谈—低语者是指说话声音超低几乎让人听不明白的人。与低语者交谈往往会导致沟通错误且混杂各种信号，这种场景在上世纪90年代知名情景喜剧《低语者》中体现得淋漓尽致。

那么，低语者与电子系统及其设计有何关系呢？现代电子信号链已开始更多地采用在较低电压节点运行的集成电路（IC）。Sub-1V器件，如大型微处理器、现场可编程门阵列（FPGA）、低功耗通信器件和传感器，只是为了降低功耗和延长电池寿命而将电压降低于1V的设备类型中的几种。这些器件的电压较低也意味着它们的输入/输出（I/O）数据接口需要在较低的电压下工作。实际上，这些新型低电压信号链器件正成为该系统的低语者。

FPGA调试的那些事.....

作者：依元素科技

FPGA调试时硬件设计中及其重要的一步，本文就在FPGA调试过程中存在3种常见的误解，进行一些讨论:

误解#1：调试工作的存在, 是因为工程师不够称职。

误解#2：单一处理方法应解决所有调试问题。

误解#3：FPGA调试硬件总是“浪费”资源。

首先针对误解#1,调试工作是设计过程的一部分

基于 Speedgoat 系统验证 FPGA 算法

FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它作为专用集成电路（ASIC）领域中的一种半定制电路而出现，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点。主要用于信号处理及各类高速模拟仿真。

H.264三种码率控制方法(CBR, VBR, CVBR)

CBR（Constant Bit Rate）是以恒定比特率方式进行编码，有Motion发生时，由于码率恒定，只能通过增大QP来减少码字大小，图像质量变差，当场景静止时，图像质量又变好，因此图像质量不稳定。这种算法优先考虑码率(带宽)。

这个算法也算是码率控制最难的算法了，因为无法确定何时有motion发生，假设在码率统计窗口的最后一帧发生motion，就会导致该帧size变大，从而导致统计的码率大于预设的码率，也就是说每秒统计一次码率是不合理的，应该是统计一段时间内的平均码率，这样会更合理一些。

适用于 Xilinx Zynq® UltraScale+™ ZU2CG−ZU5EV MPSoC 的集成电源参考设计

TIDA-01480 参考设计是一种可扩展的电源设计，旨在为 Xilinx Zynq UltraScale+ (ZU+) 系列 MPSoC 器件供电。此设计接收来自标准直流电源的电力，并通过明确的 Samtec 插座端子板连接方式为 Xilinx 芯片组和 DDR 存储器的所有电源轨供电。

此设计具有可扩展性，能够支持整个 ZU+ 系列的器件：从最基础的具有双核 ARM® Cortex™-A53 应用处理器和双核 ARM® Cortex™-R5 实时处理器的 ZU2CG 器件，到添加了图形处理单元 (GPU) 的 ZUxEG 产品，再到最高配的还包含一个视频编解码器单元和多达 16 个 16.3Gbps 收发器 (MGTH) 的 ZU5EV 器件，均包含在内。

一文了解赛灵思新一代闪存存储解决方案

今年的闪存峰会 (FMS, Flash Memory Summit ) 重点关注的是非易失性存储器 Express (NVMe)、架构端非易失性存储器 (NVMe-oF)、永久存储器等前沿的存储器技术以及关键的开源软件主题。作为面向主机连接性可投产存储阵列的领先品牌，赛灵思展示了一系列涵盖不同生态系统、合作伙伴和客户的新一代闪存存储解决方案。

数据泛滥的时代
云计算无处不在。云端环境的计算要求呈指数级增长，与此同时，摩尔定律的放缓制约了传统计算技术的跟进。高计算强度工作负载的出现与普及导致当今对灵活应变异构计算架构的需求大大超出以往。

华为云发布国内首款FPGA云视频编码加速服务

近日，华为云联合全球领先视频编码加速方案提供商NGCodec发布国内云上首款基于FPGA平台的视频编码加速服务，该服务提供针对视频直播场景专业优化的H.265编码器Chestnut A，并采用业界领先的FPGA视频流媒体加速技术，对视频直播的编码计算进行极致加速，相对于传统的基于CPU的编码处理将H.265编码性能提升2倍以上，功耗降低2倍以上，码率相对于标准264降低33%以上。而且，相对于GPU自带的编码器，基于FPGA实现的H.265编码器可以在同等画质降低码率34%。

适用于 Xilinx® Zynq®-7、Spartan®-7 和 Zynq®-7000 FPGA 的集成电源参考设计

该参考设计是一种可扩展的电源设计，旨在为基于 FPGA 的 Artix-7、Spartan-7 和 Zynq-7000 系列器件供电。此设计接收来自标准直流电源的电力，并通过明确的 Samtec 插座端子板连接方式为 Xilinx 芯片组和 DDR 存储器的所有电源轨供电。

PYNQ直播：加速电机控制应用中的边缘分析和机器学习部署

你想知道如何为电机控制或者其它工业物联网应用实现远程诊断和预测性维护吗？此次研讨会将通过名为“PYNQ”的革新型架构向您展示赛灵思 Zynq SoC在工业物联网边缘智能和控制应用中的“自适应”的能力。。Python + Zynq= PYNQ。PYNQ是赛灵思公司开发的一个开源项目，旨在让基于赛灵思Zynq的嵌入式系统设计更加容易。其结合了业界最流行编程语言Python的高效生产力和丰富的开源分析库和机器学习库，以及赛灵思Zynq SoC 灵活可扩展的特性，可加速实现电机控制中边缘分析和机器学习的快速部署。

Python实现TFTP

一、TFTP协议简单介绍

1、定义

TFTP（Trivial File Transfer Protocol)：简单文件传输协议）。

TFTP是TCP/IP协议族中的一个用来在客户端与服务器之间进行简单文件传输的协议，传输不复杂、开销不大的文件。端口号固定为69。

TFTP是一个传输文件的简单协议，它基于UDP协议而实现。

2、特点

简单、占用资源少、基于UDP实现、端口号为69、适合在局域网内传输小文件。

CNN在ZYNQ上的实现

ZYNQ简介

ZYNQ系列是Xilinx推出的高端嵌入式SoC，其在片上集成了ARM处理器和FPGA。ZYNQ与传统的嵌入式CPU相比，具有强大的并行处理能力。开发人员利用FPGA强大的并行处理能力，不仅可以解决多种不同信号处理应用中的大量数据处理问题，而且还能通过加入更多外设来扩展处理系统的功能。ZYNQ通过引入最新的高速AXI-4总线，可轻松实现外设的扩展与高速互访。