DAC

乘法 DAC 是波形发生应用的理想构建模块。因为乘法数模转换器 (DAC) 的 R-2R 架构非常适合低噪声、低毛刺、快速建立的应用。

从固定参考输入电压产生波形时，必须考虑一些重要的交流规格，包括建立时间、中间电平毛刺和数字 SFDR。

今天我们就来分析下这些与波形发生相关的重要 DAC 规格。

<strong>建立时间</strong>

假设 DAC 由真实的宽带低阻抗信号源（参考电压和接地引脚）驱动，那么它会迅速建立。因此，乘法 DAC 的压摆率和建立时间主要由运算放大器决定。决定运算放大器交流性能的规格包括其输入电容（必须保持最小）和 3 dB 小信号带宽。注意，运算放大器的带宽之所以受限，是因为它必须驱动 DAC 反馈电阻这一较大负载。例如，10 kΩ 的反馈电阻就是一个相当大的负载，它是决定电路配置带宽的主要极点。

<strong>电路功能与优势</strong>

图1所示电路提供了一种利用按钮控制数字电位计取代传统高压机械电位计的完整解决方案。

在该电路中，低压数字电位计通过简单的按钮式开关控制电池或其他来源提供的最高20 V高压源，简便易用，电源效率极佳。数字电位计AD5116提供64个游标位置，端到端电阻容差为±8%，适合各类调整应用。此外，AD5116内置一个EEPROM，可通过一个按钮将游标位置手动保存到所需位置。此特性在需要默认上电位置的应用中很有用......

DAC基础知识：静态技术规格以及它们对DC的偏移、增益和线性等特性的影响在平衡双电阻 (R-2R) 和电阻串数模转换器 (DAC) 的各种拓扑结构间是基本一致的。然而，R-2R和电阻串DAC的短时毛刺脉冲干扰方面的表现却有着显著的不同。

我们可以在DAC以工作采样率运行时观察到其动态不是线性。造成动态非线性的原因很多，但是影响最大的是短时毛刺脉冲干扰、转换率/稳定时间和采样抖动。

用户可以在DAC以稳定采样率在其输出范围内运行时观察短时毛刺脉冲干扰。图1显示的是一个16位R-2R DAC，DAC8881上的此类现象。

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这个16位DAC (R-2R) 输出显示了7FFFh – 8000h代码变化时的短时毛刺脉冲干扰的特性。

作者：HighSpeedMkt

高速转换器采用深亚微米CMOS技术和专有架构，有望实现业界领先的高动态范围关键参数性能。这将从以下三个方面推动下一个千兆赫兹带宽、软件定义系统浪潮。

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<strong>让5G大放异彩</strong>

从车辆间通信到手持设备上玩大型游戏，都将需要5G网络的速度和即时响应时间。将5G功率投入大众市场的关键是在基站应用和5G连接设备中使用28纳米高速ADC和DAC。

该篇将分析对象限定为一个DAC，其中的输出缓冲器在正常模式下被加电：零量程或中量程。文章将分析一下DAC输出在高阻抗模式中被加电的情况。同时提出一个针对加电毛刺脉冲的数学模型，随后给出一个尽可能减少此毛刺脉冲的电路板级解决方案。

<strong>原理</strong>
该篇将分析对象限定为一个DAC，其中的输出缓冲器在正常模式下被加电：零量程或中量程。文章将分析一下DAC输出在高阻抗模式中被加电的情况。同时提出一个针对加电毛刺脉冲的数学模型，随后给出一个尽可能减少此毛刺脉冲的电路板级解决方案。

<strong>原理</strong>