FPGA 还有另一条路？Efinix 正在重新思考“逻辑与布线”的取舍在 FPGA 的世界里，有一个几乎所有工程师都会遇到的问题：逻辑资源够了，但布线过不去。或者反过来： 布线资源很多，但逻辑已经用完。 
ALINX VD100+Simulink 快速实现 FPGA 图像处理 Sobel 边缘检测
原文作者：Adam Taylor
原文标题：MicroZed Chronicles: Creating Image Processing with Simulink
原文链接：https://www.adiuvoengineering.com/post/microzed-chronicles-creating-image-processing-with-simulink
Github 链接：https://github.com/ATaylorCEngFIET/mz629
AXI协议自定义IP
作者：Chen Yang，AMD工程师；文章来源：AMD开发者社区
在基于 ARM + FPGA 的 SoC 设计中（如 Zynq / Zynq MPSoC / Versal），AXI 总线几乎贯穿了整个系统。无论是 PS 访问 PL 里的控制寄存器，还是软件驱动硬件加速单元，自定义 AXI Peripheral IP 都是一个绕不开的技能
在实际项目中，标准或半定制的 AXI4 IP 已经可以通过 HLS 生成，尤其适合算法密集型或数据通路导向的设计场景。然而，在需要状态完全可控、寄存器模型频繁变化的场景下，仍然需要采用 RTL 级 AXI4 协议 IP。
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