本指南内容涵盖了XSDB 命令、XSDB 用例和硬件软件接口（ HSI ）命令。

作为 MATLAB® R2025a 版的一部分，AMD Vitis™ HLS 开发人员现在可以使用强大而简化的流程，直接从 MATLAB（.m code）环境生成 Vitis HLS C++ 代码。

AMD 深耕汽车行业多年，在驾驶员监控系统（ DMS ）领域积淀深厚，这些系统深度集成于 L2、L2+ 和 L3 级车辆中

在这里，你将与志同道合的朋友畅所欲言，分享自己在 FPGA 领域的宝贵经验与奇思妙想，让你在轻松愉快的氛围中收获知识与拓展人脉。

在网表中，这些资源被称为 LUTRAM 或分布式 RAM。这些 LUTRAM 不像 Vivado 中的其他单元那样遵循典型结构。本文说明了推断或例化的 LUTRAM 的结构。 

既然讲到CXP ，就不能不提PCIe,市面上常见的CXP 采集卡是基于PCIe接口的，为了满足CXP 电口 12.5G 4lane/8lane 或者基于光口的40G/100G 的数据传输带宽

在算力需求爆炸式增长的今天，GPU与CPU常占据头条，但 FPGA（现场可编程门阵列）  凭借其独特的硬件并行能力，正悄然重塑高性能计算的边界。

本文将侧重于概述如何创建和运行设计以将这两个 IP 结合在一起来实现。

该解决方案将莱迪思CertusPro™-NX传感器到以太网桥接板与英伟达Holoscan平台相结合，为实时数据采集和处理提供了一个灵活的全栈平台。

西安电子科技大学集成电路学部四十多名师生走进中科亿海微，通过技术报告、实地参观与深度交流等环节,，展开了一场聚焦FPGA产业前沿的实践活动，

AMD Power Design Manager 2025.1 版（PDM）现已推出——增加了对第二代 AMD Versal™ AI Edge 和 第二代 Versal Prime 系列的支持

本章介绍了可用于初始化、运行、更新和控制外部控制器中图形执行的控制API。本章还描述了如何在输入图规范中指定运行时参数（RTP）

ALINX 作为 FPGA 开发板领域领先供应商，RFSoC 系列开发板精准定位于雷达通信、5G 基站、卫星通信、测试测量等对性能要求严苛的高端射频应用

功率放大器 (PA) 线性化是无线接入网 (RAN) 面临的一项关键挑战，其对计算资源要求严苛。而随着网络向更高频段、更大带宽和更加动态的流量负载发展

SEM IP 在上板调试过程中有时会出现一些错误,需要访问 log 文件以便调试。本篇博文涵盖了如何利用 FIFO+ILA/VIO 抓取 SEM IP Monitor Interface 的 log 文件。

数据流图内核对无限长的类型值序列的数据流进行操作。这些数据流可以被分成单独的块，这些块由内核处理。内核消耗输入数据块并产生输出数据块

Televisa 的全新硬件平台源自 Siselectron，以卓越的密度和灵活性大幅降低功耗，并实现尖端的性能。

在每一次系统迭代的背后，隐藏着一场对“芯”的战争。无论是通信设备还是高清视频处理系统，从数据中心到工业控制，高性能 FPGA始终是关键器件之一。

MD 面向嵌入式应用打造高性能、高能效处理器，全方位满足网络、存储、汽车、工业、零售、医疗、测试与测量等领域的各种需求

该系列面向高算力、高清视频、高速通信等关键应用场景，集成丰富硬核资源、兼容主流方案、性能大幅提升